如何使用FPGA加速機(jī)器學(xué)習(xí)算法？.doc

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1、如何使用FPGA加速機(jī)器學(xué)習(xí)算法？　　當(dāng)前，AI因為其CNN（卷積神經(jīng)網(wǎng)絡(luò)）算法出色的表現(xiàn)在圖像識別領(lǐng)域占有舉足輕重的地位?；镜腃NN算法需要大量的計算和數(shù)據(jù)重用，非常適合使用FPGA來實現(xiàn)。上個月，RalphWitTIg（XilinxCTOOffice的卓越工程師）在2016年OpenPower峰會上發(fā)表了約20分鐘時長的演講并討論了包括清華大學(xué)在內(nèi)的中國各大學(xué)研究CNN的一些成果?！　≡谶@項研究中出現(xiàn)了一些和CNN算法實現(xiàn)能耗相關(guān)的幾個有趣的結(jié)論：　?、傧薅ㄊ褂闷螹emory;　?、谑褂酶〉某朔ㄆ?　　③進(jìn)行定點匹配：相對于32位定點或浮點計算，將定點計算結(jié)果精度降為

2、16位。如果使用動態(tài)量化，8位計算同樣能夠產(chǎn)生很好的結(jié)果?！　≡谘葜v中WitTIg還提到了CNN相關(guān)的兩款產(chǎn)品：CAPI-compaTIbleAlphaDataADM-PCIE-8K5PCIe加速卡和AuvizSystems提供的AuvizDNN（深度神經(jīng)網(wǎng)絡(luò)）開發(fā)庫?！　　　DM-PCIE-8K5PCIe加速卡　　AlphaDataADM-PCIE-8K5PCIe加速卡用于X86和IBMPower8/9數(shù)據(jù)中心和云服務(wù)，加速卡基于XilinxKintexUltraScaleKU115FPGA，支持XilinxSDAcess基于OpenCL、C/C++的開發(fā)和基于Vivado

3、HLx的HDL、HLS設(shè)計流程?！　　　D1AlphaDataADM-PCIE-8K5PCIe加速卡　　AlphaDataADM-PCIE-8K5PCIe加速卡片上帶32GBDDR4-2400內(nèi)存（其中16GB含ECC），雙通道SFP+支持雙通道10G以太網(wǎng)接入。提供包括高性能PCIe/DMA在內(nèi)的板級支持包（BSP）、OpenPOWER架構(gòu)的CAPI、FPGA參考設(shè)計、即插即用的O/S驅(qū)動和成熟的API等設(shè)計資源?！　　　uvizDNN開發(fā)庫　　深度學(xué)習(xí)技術(shù)使用大量的已知數(shù)據(jù)來找出一組權(quán)重和偏置值來匹配預(yù)期結(jié)果。處理被稱之為訓(xùn)練，訓(xùn)練的結(jié)果是大量的模型，這一事實促使工程師們

4、尋求使用GPU之類的專用硬件來進(jìn)行訓(xùn)練和分類計算?！　‰S著未來數(shù)據(jù)量的巨幅增長，機(jī)器學(xué)習(xí)將會搬到云端完成。這樣就急需一種既可以加速算法，又不會大規(guī)模增加功耗的處理平臺，在這種情況下，F(xiàn)PGA開始登場?！　‰S著一些列的先進(jìn)開發(fā)環(huán)境投入使用，軟件開發(fā)工程師將他們的設(shè)計在XilinxFPGA上實現(xiàn)變得更加容易。AuvizSystems開發(fā)的AuvizDNN庫為用戶提供優(yōu)化的函數(shù)接口，用戶可以針對不同的應(yīng)用創(chuàng)建自定義的CNN。這些函數(shù)可以方便的通過XilinxSDAcess這樣的集成開發(fā)環(huán)境調(diào)用。在創(chuàng)建對象和數(shù)據(jù)池后，就會調(diào)用函數(shù)創(chuàng)建每一個卷積層、然后是致密層，最后是softmax層，

5、如下圖2所示?！　　　D2實現(xiàn)CNN的函數(shù)調(diào)用順序