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1、1.常用仿真命令vlibwork???//建立work仿真庫vmapworkwrok??//映射庫vlog??-cover?bcest?*.v???//加覆蓋率分析的編譯vsim?-coverage?-voptargs="+acc"?-t?ns?test??//仿真文件為test.vaddwave?*????//將所有模塊waveform.dump出來addwavesim:/test/t/M2/Reg_out????????//將模塊Reg_out中的waveform.dump出來delete?wav
2、e?/test/i2.SVA斷言仿真命令vlog?-sv?a.vvsim?-assertdebug?testview?assertionsvsim?-assertdebug?ScaleBlock_tf?-L?xilinxcorelib_ver?-L?unisims_ver??//加載xilinxlib庫3.verror?3601??//查錯4.給仿真工具加載xilinx庫命令(1)加載之前將modelsim.ini改為非“只讀”(2)“運行”cmd，到xilinx目錄下(3)C:Xilinx>?co
3、mpxlib?-s?mti_se?-p?c:Modeltech_6.0win32?-f?all?-l?verilog?-o?C:Modeltech_6.0Xilinx_lbis或者?Xilinx目錄下.bint下有compxlib.exe簡單得modelsim命令行仿真??????????????????????????????????????用do文件進行仿真真得很方便，比寫testbench方便多了，我是深有感觸呀，開始時因為不知道，只知道寫testbence，在小得模塊也寫tes
4、tbench,真得很煩躁！而且信號定義什么得比較多，采用do文件得方法就沒有那么多信號定義了，管理也比較方便，呵呵，真得很方便，而且采用命令行得形式，感覺特有成就感，呵呵！1.運行仿真，在主窗口輸入命令：vsimwork.實體名2.為時鐘信號添加驅動，輸入命令：forceclk00,110-r20，將仿真時鐘設為50MHz；(設時間單位為ns)3.打開波形窗口，輸入命令：viewwave4.為波形窗口添加信號，輸入命令：addwave-hex*，這里的*表示添加設計中所有的信號，-hex表示以十六進制
5、來表示波形窗口中的信號值；5.開始仿真，輸入命令，run3us，這時候在波形窗口中出現(xiàn)仿真波形6.退出仿真，輸入命令：quit–sim。modelsim常用命令分類：Verilog/FPGA2010-05-2610:49354人閱讀評論(1)收藏舉報用do文件進行仿真真得很方便，比寫testbench方便多了，采用do文件沒有那么多信號定義，管理也比較方便.?1.運行仿真，在主窗口輸入命令：vsimwork.實體名2.為時鐘信號添加驅動，輸入命令：forceclk00,110-r20，將仿真時鐘設為5
6、0MHz；(設時間單位為ns)3.打開波形窗口，輸入命令：viewwave4.為波形窗口添加信號，輸入命令：addwave-hex*，這里的*表示添加設計中所有的信號，-hex表示以十六進制來表示波形窗口中的信號值；5.開始仿真，輸入命令，run3us，這時候在波形窗口中出現(xiàn)仿真波形6.退出仿真，輸入命令：quit–sim//很常用!!7.查看錯誤詳細信息:verror**(錯誤數(shù)字代號)--vlib-建立一個新的工作庫。如：vlibwork???????在當前目錄建立邏輯庫work，運行后會在當前目
7、錄下找到work文件夾。--vmap-映射邏輯庫名到指定的目錄--vsim-啟動仿真如：vsim-c-lvsim.log-do./YourDo.do-L./workwork.foo???開始仿真，-c選項讓vsim工作在commandline模式；-l選項是輸出log文件到vsim.log；-do選項是開始仿真后運行tcl腳本文件；-L選項是指定工作邏輯庫；work.foo是仿真的toplevelmodule。odelSim之命令行仿真入門下面是我們的Tcl仿真步驟：啟動ModelSimSE,首先看到
8、在在ModelSimSE右邊的窗口有ModelSim>這樣的提示符。在提示符后，順序運行以下命令：???vlibwork?該命令的作用是在該目錄下建立一個work目錄，請注意不要用操作系統(tǒng)來新建一個work的文件夾，因為用操作系統(tǒng)建立的work文件夾并沒有ModelSimSE自動生成的_info文件。???vmapworkwork???該命令的作用是將目前的邏輯工作庫work和實際工作庫work映射對應。???vlogcamera.v?camera_tb
