余孟嘗第三版課后習題答案第五章習題題目

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1、自我檢查題5.1時序電路和組合電路的根本區(qū)別是什么？同步時序電路與異步時序電路有何不同？5.2畫出圖T5.2所示電路的狀態(tài)和時序圖，并簡述其功能。5.3試用邊沿JK觸發(fā)器和門電路設計一個按自然態(tài)序進行計數(shù)的七進制同步加法計數(shù)器。5.4畫出用時鐘脈沖上升沿觸發(fā)的邊沿D觸發(fā)器組成的4位二進制異步加法計數(shù)器和減法計數(shù)器的邏輯電路圖。5.5試畫出用兩片74161構成的24進制計數(shù)器的電路連線圖。5.6試畫出用兩片4位雙向移位寄存器74LS194組成的8位雙向移位寄存器的連線圖。5.7指出下列各種觸發(fā)器中哪些可以用來構成移位寄存器和計數(shù)器，

2、哪些不能，凡能者在（）內(nèi)打√，不能者打×。(1)基本RS觸發(fā)器（）（2）同步RS觸發(fā)器（）（3）同步D鎖存器（）（4）邊沿D觸發(fā)器（）（5）邊沿JK觸發(fā)器（）5.8RAM和ROM在電路結構和工作原理上有何不同？思考題與習題題5.1時序電路如圖P5.1所示，起始狀態(tài)=001，畫出電路的時序圖。題5.2畫出P5.2所示電路的狀態(tài)圖題5.3畫出圖P5.3所示電路的狀態(tài)圖和時序圖。題5.4試畫出圖P5.4（a）電路中B、C端波形。輸入端A、CP波形如圖P5.5(b）所示，觸發(fā)器起始狀態(tài)均為零。題5.5畫出圖P5.5所示電路的狀態(tài)圖，若令=

3、1，試問電路計數(shù)順序將如何變化？題5.6試問圖P5.6所示電路的計數(shù)長度N是多少？能自啟動嗎？題5.7畫出圖P5.7所示電路的狀態(tài)圖和時序圖？題5.8試用下降沿觸發(fā)的邊沿JK觸發(fā)器設計一個同步時序電路，其要求如圖P5.8所示題5.9試用上升沿觸發(fā)的邊沿D觸發(fā)器和與非門設計一個同步時序電路，要求如圖P5.9所示題5.10設計一個脈沖序列發(fā)生器，使之在一系列CP信號作用下，其輸出端能周期性的輸出00101101的脈沖序列。題5.11設計一個步進電機用的三相六狀態(tài)脈沖分配器。如果用1表示線圈導通，用0表示線圈截止，則三個線圈ABC的狀態(tài)

4、轉換圖應如圖P5.11所示。在正轉時控制輸入端G為1，反轉時為0.題5.12設計一個按自然態(tài)序進行計數(shù)的同步加法計數(shù)器，要求當控制信號M=0時為六進制，M=1時為十二進制。題5.13分析圖P5.13所示各電路，畫出他們的狀態(tài)圖和時序圖，指出各是幾進制計數(shù)器。題5.14分析圖P5.14所示各電路，畫出他們的狀態(tài)圖和時序圖，指出各是幾進制計數(shù)器。題5.15試分別畫出利用下列方法構成的六進制計數(shù)器的連接圖：（1）利用74161的異步清零功能；（2）利用74163的同步清零功能；（3）利用74161或74163的同步置數(shù)功能；（4）利用7

5、4290的異步清零功能。題5.16試分別畫出用74161的異步清零和同步置數(shù)功能構成的下列計數(shù)器的連線圖：（1）10進制計數(shù)器；（2）60進制計數(shù)器;（3）100進制計數(shù)器；（4）180進制計數(shù)器。題5.17試分別畫出用74290構成的下列計數(shù)器的連線圖：（1）9進制計數(shù)器；（2）50進制計數(shù)器；（3）88進制計數(shù)器；（4）30進制計數(shù)器。題5.18試分別畫出用74164構成的下列環(huán)形計數(shù)器的連線圖：（1）3位環(huán)形計數(shù)器；（2）5位環(huán)形計數(shù)器；（3）7位環(huán)形計數(shù)器。題5.19試分別畫出用74164構成的蝦類扭環(huán)形計數(shù)器的連線圖：（

6、1）3位扭環(huán)形計數(shù)器；（2）4位能自啟動的扭環(huán)形計數(shù)器；（3）8位扭環(huán)形計數(shù)器。題5.20試分別畫出用74164構成的最大長度移位型計數(shù)器的連線圖：（1）3位最大長度移位計數(shù)器；（2）4位最大長度能自啟動的移位型計數(shù)器；（3）7位最大長度移位型計數(shù)器。題5.21試說明靜態(tài)RAM存儲單元和動態(tài)RAM存儲單元的主要區(qū)別是什么？他們各有什么特點。題5.22試分別畫出用兩片6116構成2K*16位和4K*8位存儲器的連線圖。題5.23試畫出用一片74LS163和兩片74LS138組成的16輸出計數(shù)型順序脈沖發(fā)生器的連線圖。題5.24試比較

7、可編程邏輯器件PROM、PLA、PAL和GAL的主要特點。題5.25用VHDL描述4位二進制計數(shù)器，并且用MAX+plusII完成其編譯和波形仿真。題5.26用VHDL描述單向移位寄存器，并用MAX+plusII完成其編譯和波形仿真。5-3解答：（1）寫方程式驅動方程：（2）求狀態(tài)方程輸出方程：(3)畫出狀態(tài)圖和時序圖狀態(tài)圖如下圖所示：時序圖如下圖所示：（4）該電路是能夠自啟動的五進制加法計數(shù)器