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《表征高速高密度背板中的串?dāng)_效應(yīng)》由會員上傳分享，免費(fèi)在線閱讀，更多相關(guān)內(nèi)容在行業(yè)資料-天天文庫。
1、CharacterizingCrosstalkCENTELLAX表征高速高密度背板中的串?dāng)_效應(yīng)WilliamSitchCentellax,Inc.August2010AN24摘要本文概述了串?dāng)_的不利影響，對比分析了串?dāng)_測量的幾種方法，并詳細(xì)介紹了高密度高速背板上串?dāng)_的鑒定方法。使用了基于誤碼率的抖動測量方法來量化近端串?dāng)_、遠(yuǎn)端串?dāng)_以及干擾信號源的相位掃描時(shí)引入的抖動。內(nèi)容串?dāng)_的定義.....................................................................................................
2、.................2串?dāng)_的仿真...................................................................................................................2串?dāng)_的測量...................................................................................................................3在頻域測量串?dāng)_引入的信號.....................
3、.................................................................3在時(shí)域測量串?dāng)_引入的信號......................................................................................5在時(shí)域測量被干擾通道的抖動...................................................................................6表征AdvancedTCA背板的串?dāng)_.............
4、..........................................................................8背板與測試環(huán)境............................................................................................................9測試儀器(PCB12500)........................................................................................
5、........12測量結(jié)果....................................................................................................................13參考文獻(xiàn)........................................................................................................................15CENTELLAX·http://www.centellax.com/
6、·sales@centellax.com·866.522.6888iSpecificationssubjecttochangewithoutnotice.Copyright?2001-2010Centellax,Inc.PrintedinUSA.Sep2010CharacterizingCrosstalkCENTELLAX串?dāng)_的定義串?dāng)_是某一個(gè)數(shù)據(jù)或時(shí)鐘信號的部分能量耦合到了另一電路或系統(tǒng)。串?dāng)_是由容性耦合或感性耦合的電磁場引起的模擬信號的干擾。在任何復(fù)雜的三維結(jié)構(gòu)上高密度的高速信號布線都容易產(chǎn)生串?dāng)_，這會導(dǎo)致以下信號完整性問題：ò噪聲增加（降低了信噪比SNR）ò增加了數(shù)據(jù)邊沿的
7、抖動（減少了器件的規(guī)范要求的余量）ò無用信號的反射（減小信號檢測器的靈敏度）優(yōu)化設(shè)計(jì)可以減輕串?dāng)_的影響。增大信號和時(shí)鐘線之間的物理間距，減小并行走線的長度，使用更多的地平面的多層板、使用差分信號都可以減小串?dāng)_。遺憾的是，當(dāng)前更小的設(shè)備上有更多的數(shù)據(jù)和時(shí)鐘線，這些優(yōu)化設(shè)計(jì)方法的作用是有限的。要有效的減小串?dāng)_，需要結(jié)合良好的布局設(shè)計(jì)與工程實(shí)踐經(jīng)驗(yàn)，必要時(shí)，在生產(chǎn)線中進(jìn)行相關(guān)測試，以確保制造公差導(dǎo)致的變化足夠小。串?dāng)_的仿真最近，電路仿真工具在分析電路性能上有很大進(jìn)展，但是仿真串?dāng)_的能力
