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《基于PowerPC8640的PCI-E總線接口設(shè)計(jì)》由會(huì)員上傳分享，免費(fèi)在線閱讀，更多相關(guān)內(nèi)容在學(xué)術(shù)論文-天天文庫(kù)。
1、第4I卷第3期航i“算拄術(shù)^?㈨ea¨■?p“I?gnchnlq”eVoI4lNo3基于PowerPc8640的PcI—E總線接口設(shè)計(jì)張偉棟1．劉志敏2中國(guó)航空計(jì)算掛術(shù)研究所，陜西西安71c】068：2空軍航空大學(xué)．吉林長(zhǎng)春130022摘￥：P“E芒a目女苒自身∞特^}*鍵掛}n勢(shì)，#§n*T一^{A標(biāo)準(zhǔn)。nmtrPc86帥自$集^有l(wèi)℃lE接口，目目$女￡一“離H＆*”gg{^☆镕TR㈣rPc8640#^∞PclE掛口目特ⅡdA#*"*』匕m#．P“we十c嘶∞¨Pc】．E拈口#*i設(shè)§設(shè)*T目#11cI．En設(shè)#∞#＆}《健月F附A∞PcI
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6、ham．Ⅱ】orFNAandus?EPEX8112whlchBPcI．EmPCIbrldEeCm?IcaIl帆8orPcI，Em珊pl?n訓(xùn)Annnctm?mpl?n州，andtheⅢ州I¨¨malFs№l‰r】訓(xùn)川甜PCIFB?memPehas州onPo?PC8640?】■)】eandth?ethodmakesham?deslg?ds曲?e1PlolIa【l?asvK掣啪rds：1心，h】?PC8640；PcIE．FPCA：PEX8112引言隨著嵌人式系統(tǒng)的不斷發(fā)展，需要處理的數(shù)據(jù)量和信息量急劇增K，這對(duì)高性能提出了更高的耍求，先進(jìn)的處理器架
7、構(gòu)和高速緩存的出現(xiàn)，使處理器的性能得劉很大的提高。f[i是處理器總線頻率的增K速度相對(duì)于處理器的發(fā)展相差很大．處理器與其他芯片或部件的通訊速度成了新的髓頸。為了滿足高性能、高帶寬、高可靠忡和高通川性Ⅳ0子系統(tǒng)的需求，業(yè)界提出了一種建立在串行點(diǎn)對(duì)點(diǎn)總線架構(gòu)上的全新結(jié)構(gòu)。PcI．E總線是第一代v0電線標(biāo)準(zhǔn)，坪想的傳輸速率為25cB／s，主要目的是片{于芯片問(wèn)的局部互連總線。它使川低電托差分信號(hào)進(jìn)行傳輸，祚保證系統(tǒng)信號(hào)完整性的同時(shí)可以大幅度提高系統(tǒng)的傳輸頻率、降低功耗。在提供了更高帶寬的同時(shí)．PclE還提供r對(duì)pcJ和PcI—x軟件的兼容支持，以及對(duì)
8、芯片之間、I／0適配器之
9、可和IEEFl394、usR20等附屬接¨的支持?閩此，?？偩€一經(jīng)推出，立即以其優(yōu)異的性能和低廉的造價(jià)引起r業(yè)界的廣泛關(guān)注，展現(xiàn)了廣闊的應(yīng)用前昂，lPcl-E總線概進(jìn)PcIF迅速得到業(yè)界的承認(rèn)，并被公認(rèn)為下一代總線標(biāo)準(zhǔn)這種新的總線技術(shù)具有以下熒鍵技術(shù)優(yōu)勢(shì)：設(shè)備之間的點(diǎn)對(duì)電串行鏈接；雙通道，高帶寬；靈活擴(kuò)展性：每個(gè)物理鏈接提供多個(gè)虛擬通道：支持同步數(shù)據(jù)傳輸；肄冉數(shù)據(jù)包和層次協(xié)議架構(gòu)；具有錯(cuò)誤處理和先進(jìn)的錯(cuò)誤報(bào)告功能．引腳少．節(jié)約審問(wèn)，減少串?dāng)_；在軟件層保持與PcI兼容，＆#日M：∞11Ⅲ05镕"日■：∞ll扎c12镕女∞
10、n※**(10¨)*m日*W^m4TR％《±*E±±＆*R^自☆＆*Ⅻ目#$航空計(jì)算技術(shù)第4l卷第3期PCI．E協(xié)議是一種層次式的體系結(jié)構(gòu)，在結(jié)構(gòu)上分為物理層、數(shù)據(jù)鏈路層和事務(wù)層三部分。結(jié)構(gòu)圖如圖l所示。事務(wù)層數(shù)據(jù)包規(guī)范數(shù)據(jù)鏈路層數(shù)據(jù)完墊}生提供用于點(diǎn)對(duì)點(diǎn)鏈接串行差物理層分通道。實(shí)現(xiàn)蝴0b編碼等圖lPCI—E總線層次體系結(jié)構(gòu)物理層定義了PCI．E的電氣特性，包含一個(gè)或多個(gè)全雙工通道負(fù)責(zé)報(bào)文的發(fā)送和接收。為了在保證信號(hào)完整性的條件下實(shí)現(xiàn)高速信號(hào)的傳輸，PcI．E使用時(shí)鐘內(nèi)嵌的串行鏈路技術(shù)，其發(fā)送器和接收器之間不傳送時(shí)鐘信號(hào)，而是在數(shù)據(jù)的發(fā)送端利用
11、8b／10b編碼機(jī)制將時(shí)鐘信號(hào)嵌入到串行數(shù)據(jù)流中，然后在接收端利用8b／10b編碼后信號(hào)中足夠的數(shù)據(jù)跳變進(jìn)行時(shí)鐘數(shù)據(jù)恢復(fù)，從而實(shí)現(xiàn)發(fā)送器和接收器之間同
