資源描述:
《Quartus II軟件使用簡明教程ppt課件.ppt》由會員上傳分享,免費在線閱讀,更多相關(guān)內(nèi)容在教育資源-天天文庫。
1、第3章QuartusII集成開發(fā)工具基于QuartusII進行EDA設(shè)計開發(fā)的流程3.1QuartusII原理圖設(shè)計1.為本項工程設(shè)計建立文件夾2.輸入設(shè)計項目和存盤元件輸入對話框3.將設(shè)計項目設(shè)置成可調(diào)用的元件將所需元件全部調(diào)入原理圖編輯窗并連接好4.設(shè)計全加器頂層文件連接好的全加器原理圖f_adder.bdf5.將設(shè)計項目設(shè)置成工程和時序仿真f_adder.bdf工程設(shè)置窗5.將設(shè)計項目設(shè)置成工程和時序仿真加入本工程所有文件5.將設(shè)計項目設(shè)置成工程和時序仿真全加器工程f_adder的仿真波形3.2QuartusII的優(yōu)化設(shè)置1.S
2、etting設(shè)置在QuartusII軟件菜單欄中選擇“Assignments”中的“Setting…”就可打開一個設(shè)置控制對話框??梢允褂肧etting對話框?qū)こ獭⑽募?、參?shù)等進行修改,還可設(shè)置編譯器、仿真器、時序分析、功耗分析等等。Settings對話框2.分析與綜合設(shè)置Analysis&SynthesisSettings項中包含有四個項目:VHDLInputVerilogHDLInputDefaultParametersSynthesisNetlistOptimization作為QuartusII的編譯模塊之一,Analysis
3、&Synthesis包括QuarutsIIIntegratedSynthesis集成綜合器,完全支持VHDL和VerilogHDL語言,并提供控制綜合過程的選項。支持Verilog-1995標準(IEEE標準1364-1995)和大多數(shù)Verilog-2001標準(IEEE1364-2001),還支持VHDL1987標準(IEEE標準1076-1987)和VHDL1993標準(IEEE標準1076-1993)。3.優(yōu)化布局布線Setting對話框的FitterSettings頁指定控制時序驅(qū)動編譯和編譯速度的選擇,如下圖所示。Fitt
4、erSettings選項頁moreFitterSettings選項頁在CompilationReport中查看適配結(jié)果在TimingClosureFloorplan中查看適配結(jié)果在ChipEditor中查看適配結(jié)果3.3QuartusII的時序分析全程編譯前時序條件設(shè)置界面“MoreSettings…”中的設(shè)置時序分析結(jié)果3.4基于宏功能模塊的設(shè)計Megafunction庫是Altera提供的參數(shù)化模塊庫。從功能上看,可以把Megafunction庫中的元器件分為:算術(shù)運算模塊(arithmetic)邏輯門模塊(gates)儲存模塊(
5、storage)IO模塊(I/O)3.4.1乘法器模塊算數(shù)運算模塊庫參數(shù)化乘法器lpm_mult宏功能模塊的基本參數(shù)表lpm_mult(1)調(diào)用lpm_mult(2)lpm_mult參數(shù)設(shè)置輸入輸出位寬設(shè)置乘法器類型設(shè)置(3)編譯仿真8位有符號乘法器電路功能仿真波形3.4.3計數(shù)器模塊計數(shù)器輸出端口寬度和計數(shù)方向設(shè)置計數(shù)器模和控制端口設(shè)置更多控制端口設(shè)置模24方向可控計數(shù)器電路lpm_counter計數(shù)器功能仿真波形參數(shù)化鎖相環(huán)宏模塊altpll以輸入時鐘信號作為參考信號實現(xiàn)鎖相,從而輸出若干個同步倍頻或者分頻的片內(nèi)時鐘信號。與直接來
6、自片外的時鐘相比,片內(nèi)時鐘可以減少時鐘延遲,減小片外干擾,還可改善時鐘的建立時間和保持時間,是系統(tǒng)穩(wěn)定工作的保證。不同系列的芯片對鎖相環(huán)的支持程度不同,但是基本的參數(shù)設(shè)置大致相同,下面便舉例說明altpll的應(yīng)用。3.4.5鎖相環(huán)模塊(1)輸入altpll宏功能模塊選擇芯片和設(shè)置參考時鐘鎖相環(huán)控制信號設(shè)置輸入時鐘設(shè)置(2)編譯和仿真鎖相環(huán)電路功能仿真波形ROM(ReadOnlyMemory,只讀存儲器)是存儲器的一種,利用FPGA可以實現(xiàn)ROM的功能,但其不是真正意義上的ROM,因為FPGA器件在掉電后,其內(nèi)部的所有信息都會丟失,再次
7、工作時需要重新配置。QuartusII提供的參數(shù)化ROM是lpm_rom,下面用一個乘法器的例子來說明它的使用方法,這個例子使用lpm_rom構(gòu)成一個4位×4位的無符號數(shù)乘法器,利用查表方法完成乘法功能。3.4.6存儲器模塊數(shù)據(jù)線、地址線寬度設(shè)置控制端口設(shè)置添加.mif文件如下圖所示是基于ROM實現(xiàn)的4位×4位的無符號數(shù)乘法器電路圖,其參數(shù)設(shè)置為:LPM_WIDTH=8LPM_WIDTHAD=8LPM_FILE=mult_rom.mif仿真結(jié)果3.4.7其他模塊Maxplus2庫主要由74系列數(shù)字集成電路組成,包括時序電路宏模塊和運算
8、電路宏模塊兩大類,其中時序電路宏模塊包括觸發(fā)器、鎖存器、計數(shù)器、分頻器、多路復(fù)用器和移位寄存器,運算電路宏模塊包括邏輯預(yù)算模塊、加法器、減法器、乘法器、絕對值運算器、數(shù)值比較器、編譯碼器和奇偶校驗器。對于這些小規(guī)模的集成