基于fpga的電子鐘設(shè)計(jì)

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1、長(zhǎng)春理工大學(xué)畢業(yè)論文目草魚(yú)草魚(yú)草魚(yú)錄草魚(yú) 第一章草魚(yú)草魚(yú)緒草魚(yú)論1草魚(yú) 第二章草魚(yú)草魚(yú)可編程邏輯器件概述及設(shè)計(jì)方案2草魚(yú) 2.1草魚(yú)CPLD/FPGA概述及VHDL語(yǔ)言的特點(diǎn)2草魚(yú) 2.2可編程邏輯器件的分類和發(fā)展歷程4草魚(yú) 2.3草魚(yú)EPF10K10LC84-4芯片簡(jiǎn)介5草魚(yú) 2.4草魚(yú)電子時(shí)鐘的設(shè)計(jì)方案6草魚(yú) 第三章草魚(yú)草魚(yú)系統(tǒng)電路設(shè)計(jì)7草魚(yú) 3.1草魚(yú)草魚(yú)總體設(shè)計(jì)7草魚(yú) 3.2草魚(yú)草魚(yú)顯示電路設(shè)計(jì)9草魚(yú) 3.2.1草魚(yú)分頻器電路10草魚(yú) 3.2.2草魚(yú)掃描電路電路12草魚(yú) 3.2.3草魚(yú)BCD碼多路選擇器13草魚(yú) 3.2.4草魚(yú)BCD譯碼器14草魚(yú) 3.2

2、.5草魚(yú)位選碼電路15草魚(yú) 3.3草魚(yú)電子時(shí)鐘計(jì)數(shù)器電路設(shè)計(jì)16草魚(yú) 3.3.1草魚(yú)秒和分計(jì)數(shù)器設(shè)計(jì)16草魚(yú) 3.3.2草魚(yú)小時(shí)計(jì)數(shù)器設(shè)計(jì)18草魚(yú) 總草魚(yú)草魚(yú)草魚(yú)草魚(yú)結(jié)24草魚(yú) 參考文獻(xiàn)25草魚(yú) 致草魚(yú)草魚(yú)草魚(yú)草魚(yú)草魚(yú)謝26草魚(yú) I--長(zhǎng)春理工大學(xué)畢業(yè)論文第一章草魚(yú)草魚(yú)緒草魚(yú)論草魚(yú) 時(shí)鐘，鯉魚(yú)自從它發(fā)明的那天起，鯉魚(yú)就成為人類的朋友，鯉魚(yú)但隨著時(shí)間的推移，鯉魚(yú)科學(xué)技術(shù)的不斷發(fā)展，鯉魚(yú)人們對(duì)時(shí)間計(jì)量的精度要求越來(lái)越高，鯉魚(yú)應(yīng)用越來(lái)越廣。草魚(yú)現(xiàn)今，鯉魚(yú)高精度的計(jì)時(shí)工具大多數(shù)都使用了石英晶體振蕩器，鯉魚(yú)由于電子鐘，鯉魚(yú)石英表，鯉魚(yú)石英鐘都采用了石英技術(shù)，鯉魚(yú)因此走時(shí)精

3、度高，鯉魚(yú)穩(wěn)定性好，鯉魚(yú)使用方便，鯉魚(yú)不需要經(jīng)常調(diào)校，鯉魚(yú)數(shù)字式電子鐘用集成電路計(jì)時(shí)時(shí)，鯉魚(yú)譯碼代替機(jī)械式傳動(dòng)，鯉魚(yú)用LED顯示器代替顯示器代替指針顯示進(jìn)而顯示時(shí)間，鯉魚(yú)減小了計(jì)時(shí)誤差，鯉魚(yú)這種表具有時(shí)，鯉魚(yú)分，鯉魚(yú)秒顯示時(shí)間的功能，鯉魚(yú)還可以進(jìn)行時(shí)和分的校對(duì)，鯉魚(yú)片選的靈活性好。草魚(yú)草魚(yú)草魚(yú)草魚(yú)草魚(yú)20世紀(jì)末，鯉魚(yú)電子技術(shù)獲得了飛速的發(fā)展，鯉魚(yú)在其推動(dòng)下，鯉魚(yú)現(xiàn)代電子產(chǎn)品幾乎滲透了社會(huì)的各個(gè)領(lǐng)域，鯉魚(yú)有力地推動(dòng)了社會(huì)生產(chǎn)力的發(fā)展和社會(huì)信息化程度的提高，鯉魚(yú)同時(shí)也使現(xiàn)代電子產(chǎn)品性能更進(jìn)一步，鯉魚(yú)產(chǎn)品更新?lián)Q代的節(jié)奏也越來(lái)越快。草魚(yú)草魚(yú) 現(xiàn)代電子設(shè)計(jì)技術(shù)的核心是ED

4、A草魚(yú)(草魚(yú)Electronic草魚(yú)Design草魚(yú)Automation草魚(yú))草魚(yú)技術(shù)。草魚(yú)EDA技術(shù)就是依賴功能強(qiáng)大的計(jì)算機(jī)，鯉魚(yú)在EDA工具軟件平臺(tái)上，鯉魚(yú)對(duì)以硬件描述語(yǔ)言HDL草魚(yú)(Hardware草魚(yú)Description草魚(yú)Language)為系統(tǒng)邏輯描述手段完成的設(shè)計(jì)文件。草魚(yú)草魚(yú)20世紀(jì)80年代末，鯉魚(yú)出現(xiàn)了FPGA（Field草魚(yú)Programmable草魚(yú)Gate草魚(yú)Array）,CAE和CAD技術(shù)的應(yīng)用更為廣泛，鯉魚(yú)它們?cè)赑CB設(shè)計(jì)的原理圖輸入，鯉魚(yú)自動(dòng)布局布線及PCB分析，鯉魚(yú)以及邏輯設(shè)計(jì)、pork邏輯仿真、pork布爾綜合和化簡(jiǎn)等方面擔(dān)任

5、了重要的角色，鯉魚(yú)為電子設(shè)計(jì)自動(dòng)化必須解決的電路建模、pork標(biāo)準(zhǔn)文檔及仿真測(cè)試奠定了基礎(chǔ)。草魚(yú)硬件描述語(yǔ)言是EDA技術(shù)的重要組成部分，鯉魚(yú)VHDL是作為電子設(shè)計(jì)主流硬件的描述語(yǔ)言。草魚(yú)本論文就是應(yīng)用VHDL語(yǔ)言來(lái)實(shí)現(xiàn)秒表的電路設(shè)計(jì)。草魚(yú)VHDL語(yǔ)言是標(biāo)準(zhǔn)硬件描述語(yǔ)言，鯉魚(yú)它的特點(diǎn)就是能形式化抽象表示電路結(jié)構(gòu)及行為，鯉魚(yú)支持邏輯設(shè)計(jì)中層次領(lǐng)域的描述，鯉魚(yú)借用了高級(jí)語(yǔ)言的精巧結(jié)構(gòu)簡(jiǎn)化電路描述，鯉魚(yú)具有電路模擬與驗(yàn)證及保證設(shè)計(jì)的正確性，鯉魚(yú)支持電路由高層向低層的綜合變換，鯉魚(yú)便于文檔管理，鯉魚(yú)易于理解和設(shè)計(jì)重用。草魚(yú)草魚(yú) 本課題選用了Altera公司的FPGA產(chǎn)品并

6、以其專門開(kāi)發(fā)軟件為平臺(tái)，鯉魚(yú)運(yùn)用VHDL硬件描述語(yǔ)言設(shè)計(jì)一個(gè)電子時(shí)鐘。草魚(yú)CPLD/FPGA以高集成度、pork高速度和高可靠性而著稱，鯉魚(yú)運(yùn)用FPGA進(jìn)行產(chǎn)品開(kāi)發(fā)，鯉魚(yú)其開(kāi)發(fā)周期短，鯉魚(yú)投資風(fēng)險(xiǎn)小，鯉魚(yú)產(chǎn)品上市速度快，鯉魚(yú)決定其有著無(wú)比的市場(chǎng)前景，鯉魚(yú)是現(xiàn)代EDA技術(shù)中廣泛運(yùn)用的硬件。草魚(yú)草魚(yú) 該系統(tǒng)通過(guò)VHDL語(yǔ)言和原理圖混合應(yīng)用的方式來(lái)實(shí)現(xiàn)電子時(shí)鐘的設(shè)計(jì)，鯉魚(yú)并下載到硬件之中進(jìn)行驗(yàn)證。草魚(yú)我們將電子時(shí)鐘的設(shè)計(jì)分成了四大模塊，鯉魚(yú)分別是時(shí)間計(jì)數(shù)器模塊；pork鍵盤(pán)控制模塊；pork顯示電路模塊和時(shí)間調(diào)整模塊。草魚(yú)草魚(yú) 本次設(shè)計(jì)主要讓我們掌握CPLD/FPGA

7、的研發(fā)過(guò)程，鯉魚(yú)掌握VHDL語(yǔ)言的編程思想及過(guò)程，鯉魚(yú)以及電子時(shí)鐘基本功能和實(shí)現(xiàn)的基本原理。草魚(yú)草魚(yú) 草魚(yú) 22長(zhǎng)春理工大學(xué)畢業(yè)論文第二章草魚(yú)草魚(yú)可編程邏輯器件概述及設(shè)計(jì)方案草魚(yú) 可編程邏輯器件PLD（Programmable草魚(yú)Logic草魚(yú)Device）是20世紀(jì)70年代發(fā)展起來(lái)的一種新的集成器件。草魚(yú)PLD是大規(guī)模集成電路技術(shù)發(fā)展的產(chǎn)物，鯉魚(yú)是一種半定制的集成電路，鯉魚(yú)結(jié)合計(jì)算機(jī)的軟件技術(shù)（EDA技術(shù)）可以快速、pork方便地構(gòu)建數(shù)字系統(tǒng)。草魚(yú)草魚(yú) 2.1草魚(yú)CPLD/FPGA概述及VHDL語(yǔ)言的特點(diǎn)草魚(yú) 草魚(yú)草魚(yú)草魚(yú)草魚(yú)草魚(yú)1、porkCPLD/FPGA

8、概述草魚(yú) 不論是簡(jiǎn)單的還