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1、大師高級課程系列之高性能低功耗鎖相環(huán)與SERDES設計高級課程“High-PerformanceLow-PowerPLLandSERDESDesign”2016年6月06-07日
2、上海------------------------------------------------------------------------------------------------------------------------------------------一、為什么參加：向大師拉扎維教授學習PLL和
3、SerDes的設計，拉扎維教授的優(yōu)秀教學技巧及先進技術深厚知識會有條不紊地提升你對當前半導體行業(yè)熱點課題的理解。TolearnPLLandSERDESdesignfromthemaster.Razavi’soutstandingteachingtechniquesandhisdeepknowledgeofthestateoftheartwillmethodicallyelevateyourunderstandingofthesehottopicsintoday’ssemiconductorindus
4、try.二、誰應該參加：參加本課程需要具備基本的模擬電路知識，對PLL和SerDes感興趣的設計工程師，設計經(jīng)理，在校的高年級本科生、研究生等。AdvancedundergraduateorgraduatestudentsandpracticingengineerswhowishtodevelopasolidknowledgeofPLLsandSERDES.Abasicunderstandingofanalogcircuitsisassumed.三、課程安排課程時間：2016年06月06—07日（2
5、天）報到注冊時間：2016年6月06號，上午8:30-9:00課程地點：上海集成電路技術與產(chǎn)業(yè)促進中心（上海市浦東新區(qū)張東路1388號21幢）四、課程注冊費用課程注冊費用4200元/人（含授課費、場地租賃費、資料費、課程期間午餐），學員交通、食宿等費用自理（報名回執(zhí)表中將提供相關協(xié)議酒店信息供選擇）；優(yōu)惠折扣：在校學生注冊費用3200元/人；4人以上團體報名優(yōu)惠可協(xié)商。------------------------------------------------------------------
6、----------------------------------------------------------------------------------------------------------------------咨詢電話：021-51096090五、報名方式請各單位收到通知后，積極選派人員參加。報名截止日期為2016年05月27日,請在此日期前將報名回執(zhí)表發(fā)送Email或者傳真至：郵件：steven.yu@lynneconsulting.com傳真:021-3327-5892
7、報名咨詢電話：021-51096090六、課程具體安排第一天課程：2016年06月06日（9:00-17:00）1、電荷泵鎖相環(huán)基本概念/FundamentalCharge-PumpPLLConcepts：基本架構，相位和頻率鎖定，循環(huán)動力學，缺陷的影響；Basicarchitecture,phaseandfrequencylocking,loopdynamics,effectofimperfections2、全數(shù)字鎖相環(huán)/All-DigitalPLLs：基本架構，優(yōu)點和缺點，時間數(shù)字轉(zhuǎn)換器設計，相
8、位噪聲的制定，最先進技術設計實例；Basicarchitecture,advantagesanddisadvantages,time-to-digitalconverterdesign,phasenoiseformulation,examplesofstateoftheart3、數(shù)字控制振蕩器/Digitally-ControlledOscillators:數(shù)字調(diào)諧環(huán)和液晶振蕩器，調(diào)諧分辨率和相位噪聲之間的權衡，最先進技術設計實例；DigitaltuningofringandLCoscillator
9、s,trade-offsbetweentuningresolutionandphasenoise,examplesofthestateoftheart第二天課程：2016年06月07日（9:00-17:00）4、數(shù)據(jù)及時鐘恢復電路設計/CDRDesign：NRZ數(shù)據(jù)時鐘恢復問題，鑒相器的拓撲結(jié)構，CDR架構，抖動特性，最先進技術案例研究；ProblemofclockrecoveryfromNRZdata,phasedetectortopologies,CDRarchi
