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基于IP核的PCIE總線接口邏輯的設(shè)計(jì)和實(shí)現(xiàn)

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1、?47??1×!"?ùú?Vol.47No.12017ü1YAeronauticalComputingTechniqueJan.2017O]IP′WPCIE?'1×?W??>Z?ùú,$ó,E?(6-[m"*-.no(p<=>,!""*710068)01:ü%PCIE}?>?,óì?X,?Z,)[×YTSPCIE}?_?e*,%`dEFIP?*<=,QXilinxVirtex-7?FPGAUáa@PCIE}?[×YT*,)S,£>?@?ee.,·?YTek&:>?àì4á3DMA?,mDMA??e?PCIE}??*70%áU。234:IP?;PCIE;FPGA;[×YT;D

2、MA56789:TN915.851:;<=>:A:?@9:1671?654X(2017)01?0116?05DesigningandImplementationBasedonIPCoreofInterfaceLogicforPCIExpressPUKai,TANGQing,TIANYuan(Xi′anAeronauticsComputingTechniqueResearchInstitute,AVIC,Xi′an710068,China)Abstract:WhenPCIEisusedforinterconnectionofdevices,theinterfacelogicis

3、neededforinteractionbetweenthebusandinternalfunction.ThispaperadoptedamethodbasedonIPcore,andcompletedthedesigningandimplementationoftheinterfacelogicinXilinxVirtex-7seriesFPGA.Thenthefunctionandperformancewasverified.TheresultsshowedthatregistersaccessinganddatatransferinDMAmodewerecorrect

4、lyandthebandwidthofDMAtransmissionwasmorethan70%.Keywords:IPCore;PCIE;FPGA;interfacelogic;DMAAB3&euy,ów·nPCIEó??C?ê[1-2]M$3?Y。e+U3)?aC3

5、k??z?8?,w?3?÷_??3P@[3]ó3m·,??ePCI37

6、ú?_de?v?{j,{

7、_?÷u?v?3?2002üoIntel,8t|·H?é

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12、e=633&w·;ePCIE}ó3u?,uM¥b?3aC3?-。LastDWBEP??Q¥35,C;1stDW[6][7]:~

13、Xilinx7GFPGAH3PCIE?ˉeBEP???Q¥35,C;AddressP??,b?PCIEmBYZ,NfPCIEYé;Com

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16、PCIE?ˉe3,ü_e-

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